XC5VSX95T-2FF1136I

ViTEX®- 5系列提供了最新的最強(qiáng)大的功能在FPGA市場。使用第二代ASMBL（先進(jìn)的硅模塊塊）列為基礎(chǔ)的架構(gòu)，ViReX-5系列包含五個(gè)不同的平臺（子家族），是由FPGA家族提供的最多選擇。每個(gè)平臺包含不同的特征比率，以滿足各種高級邏輯設(shè)計(jì)的需要。除了最先進(jìn)、高性能的邏輯結(jié)構(gòu)外，ViReX-5 FPGA還包含許多硬IP系統(tǒng)級塊，包括強(qiáng)大的36千位塊RAM /FIFO、第二代25×18 DSP片、具有內(nèi)置數(shù)字阻抗的SelectIO技術(shù)、ChIP-Syc源同步。終端塊，系統(tǒng)監(jiān)視器功能，增強(qiáng)的時(shí)鐘管理瓦片與集成的DCM（數(shù)字時(shí)鐘管理器）和鎖相環(huán)（PLL）時(shí)鐘發(fā)生器，以及先進(jìn)的配置選項(xiàng)。額外的平臺依賴特性包括用于增強(qiáng)串行連接的功率優(yōu)化的高速串行收發(fā)器模塊、PCI Express®兼容的集成端點(diǎn)塊、三模式以太網(wǎng)MAC（媒體訪問控制器）和高性能PowerPC®440微處理器嵌入式BLO。CKS。這些特性允許高級邏輯設(shè)計(jì)者在其基于FPGA的系統(tǒng)中構(gòu)建最高級別的性能和功能。VITEX-5 FPGA是基于65納米的最先進(jìn)的銅工藝技術(shù)，是定制ASIC技術(shù)的一種可編程替代方案。大多數(shù)先進(jìn)的系統(tǒng)設(shè)計(jì)需要FPGA的可編程強(qiáng)度。VIETEX-5 FPGA提供了解決高性能邏輯設(shè)計(jì)者、高性能DSP設(shè)計(jì)者和高性能嵌入式系統(tǒng)設(shè)計(jì)者的最佳解決方案，具有前所未有的邏輯、DSP、硬/軟微處理器和連接性能力。ViReX-5 SXT平臺包括先進(jìn)的高速串行連接和鏈路/事務(wù)層能力。

XC5VSX95T-2FF1136I

關(guān)鍵特征

五個(gè)平臺LX、LXT、SXT、TXT和FXT

VIETEX-5LX：高性能通用邏輯應(yīng)用

VIETEX-5LXT：具有高級串行連接的高性能邏輯

VIETEX-5 SXT:具有先進(jìn)串行連接的高性能信號處理應(yīng)用

VITEX-5 TXT：雙密度先進(jìn)串行連接的高性能系統(tǒng)

VIETEX-5 FXT:具有先進(jìn)串行連接的高性能嵌入式系統(tǒng)

跨平臺兼容性

LXT、SXT和FXT設(shè)備在同一封裝中使用可調(diào)電壓調(diào)節(jié)器兼容

最先進(jìn)、高性能、最優(yōu)利用、FPGA織物

實(shí)6輸入查找表（LUT）技術(shù)

雙重5-LUT期權(quán)

改進(jìn)的跳數(shù)路由算法

64位分布式RAM選項(xiàng)

SRL32／雙SRL16選項(xiàng)

強(qiáng)大的時(shí)鐘管理瓦片（CMT）時(shí)鐘

用于零延遲緩沖、頻率合成和時(shí)鐘移相的數(shù)字時(shí)鐘管理器（DCM）塊

用于輸入抖動濾波、零延遲緩沖、頻率合成和相位匹配時(shí)鐘分割的PLL塊

36千位塊RAM /FIFO

雙端口RAM塊

增強(qiáng)型可選可編程FIFO邏輯

可編程

真正的雙端口寬度到X36

簡單的雙端口寬度到X72

內(nèi)置可選糾錯(cuò)電路

可選地將每個(gè)塊編程為兩個(gè)獨(dú)立的18千位塊。

高性能并行SelectIO技術(shù)

1.2～3.3V I/O操作

利用ChIPSCAN技術(shù)實(shí)現(xiàn)源同步接口

數(shù)字控制阻抗（DCI）主動端接

柔性細(xì)粒度I/O銀行

高速內(nèi)存接口支持

先進(jìn)的DSP48切片

25×18，二補(bǔ)，乘法

可選加法器、減法器和累加器

可選流水線

可選的按位邏輯功能

專用級聯(lián)連接

靈活配置選項(xiàng)

SPI與并行閃存接口

具有專用回退重構(gòu)邏輯的多比特流支持

汽車總線寬度檢測能力

所有設(shè)備的系統(tǒng)監(jiān)控能力

片上/片外熱監(jiān)視

片上/片外電源監(jiān)控

JTAG對所有監(jiān)測量的訪問

PCI Express設(shè)計(jì)的集成端點(diǎn)塊

LXT、SXT、TXT和FXT平臺

符合PCI Express基本規(guī)范1.1

每個(gè)塊的X1、X4或X8車道支持

與ROKETIO衛(wèi)星收發(fā)器結(jié)合的工作

三模式10/100／1000 Mb/s以太網(wǎng)MAC

LXT、SXT、TXT和FXT平臺

ROKETIO收發(fā)器可以用作PHY或使用許多軟MII（媒體獨(dú)立接口）連接到外部PHY

RokTiO GTP收發(fā)器100 Mb/s至3.75 Gb/s

LXT和SXT平臺

RokTiO GTX收發(fā)器150 Mb/s至6.5 Gb/s

TXT和FXT平臺

PowerPC 440微處理器

只有FXT平臺

RISC體系結(jié)構(gòu)

七級管道

包含32字節(jié)的指令和數(shù)據(jù)緩存

優(yōu)化的處理器接口結(jié)構(gòu)（縱橫）

65 nm銅CMOS工藝技術(shù)

1.0V鐵芯電壓

高信號完整性倒裝芯片封裝標(biāo)準(zhǔn)或無PB封裝選項(xiàng)

5962-0152001VPA 

5962-0720401VXC 

5962-0720801VXC(ADS5463MHFG-V) 

5962-0723001VXC 

5962-1022101VSC/TPS50601MHKHV 

5962-8002101VSA 

5962-9679001NXB（ SMQ320C32PCMM50 

5962-9866101VXA 

5962-9957001Q2A

ADC12J2700NKET 

ADG811YRUZ

ADS1243SJD 

ADS1278HPAP

ADS1278SHFQ

ADS54J40IRMPT 

ADC12J4000NKE

ADC12J4000NKE10

ADC12J4000NKET

ADC12J4000NKER

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